1、PAS：缩短设计闭环的先锋技术
物理感知合成（PAS）将物理设计信息（如布局、连线、拥塞、功耗）提前纳入 RTL 合成阶段，使合成结果与后端布局更一致，从而减少反复迭代，提升设计效率与 PPA（性能-功耗-面积）表现。
2、核心技术亮点与典型案例
I. 时序驱动综合（Timing-Driven Synthesis）
结合 Cadence Innovus 工具进行物理信息驱动的布局与优化，大幅缩短合成运行时间，并在 7nm 节点实现更稳定的时序闭环效率提升。
II. 拥塞感知综合（Congestion-Aware Synthesis）
通过合理分布单元布局，缓解拥塞风险，并提升连线可行性。网络处理器团队利用 Synopsys Design Compiler 的相关功能，减少布局拥塞、降低迭代次数、提升整体时序性能。
III. 功耗感知综合（Power-Aware Synthesis）
面向移动处理器设计，采用多阈值单元（Multi-Vt）与时钟门控等技术，将电源优化提前合成流程，显著降低动态与静态功耗。
IV. 分层物理综合（Hierarchical Physical Synthesis）
将复杂设计分成多个独立 Block，分别优化后再集成，有助于提升设计可控性、缩短合成时间，并提高性能准确性。
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